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created: 2026-09-20
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updated: 2026-09-20
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sources:
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- raw/youtube/2026-09-20_techtechpotato-silicon-notebook-e2.md
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tags: [concept, hardware, custom-silicon, ai-infrastructure, memory, ddr4, ddr5, cxl, risc-v, co-packaged-optics, edge-rechenzentrum, interconnects]
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# AI-Infrastruktur-Silizium — Custom-Chips, Edge-Racks und das Gedächtnis
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> *„Day two of the AI Infrastructure Summit, where the running theme is everyone building their own silicon."*
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> — Videobeschreibung, [TechTechPotato](https://www.youtube.com/@TechTechPotato), 20.09.2026
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Quelle: [[../../people/ian-cutress.md|Dr. Ian Cutress]] in „The Silicon Notebook E2" ([Video](https://www.youtube.com/watch?v=31_eeq3ciRA), [Rohquelle](../../../raw/youtube/2026-09-20_techtechpotato-silicon-notebook-e2.md), Kanal [[../../institutions/more-than-moore.md|TechTechPotato]]). **Kein Transkript** — alle Stationen dieses Blatts stammen aus den Kapitelmarken und der Beschreibung, nicht aus dem Gesprochenen.
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## Was am Summit gezeigt wurde
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| Zeit | Station | Was der Kanal nennt |
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| 00:00 | [Qualcomm](https://www.qualcomm.com/) | **AlphaWave** — Custom Silicon |
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| 00:56 | [Broadcom](https://www.broadcom.com/) | **Tomahawk 6** — Packages mit **17.000 Pins** |
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| 02:12 | Giga.io | ein **Sechs-Slot-Rack**, das durch die Flughafen-Sicherheitskontrolle passt |
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| 04:58 | (Diskussion) | wer Compute kauft, das an kein Rechenzentrum angeschlossen ist |
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| 06:21 | [d-Matrix](https://www.dmatrix.ai/) | **Corsair** und **Pavehawk** |
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| 06:57 | d-Matrix | **NVLink-Vereinbarung** |
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| 07:38 | Lightning | **gestapelter DRAM** („stacked DRAM") |
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| 08:25 | Mango Boost, [Credo](https://www.credosemi.com/) | Interconnect-/Beschleuniger-Ebene |
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| 09:26 | [Astera Labs](https://www.asteralabs.com/) | **Leo 2** — **DDR4 und DDR5 im selben System** auf einer Next-Gen-Intel-CPU |
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| 11:38 | [SiFive](https://www.sifive.com/) | **RISC-V** |
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| 12:01 | [Ayar Labs](https://ayarlabs.com/) | **Co-Packaged Optics** |
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| 13:20 | — | Wrap und Ausblick auf den nächsten Tag |
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Das ist die Themenliste eines Fach-Events: **Silizium, Speicher, Verbindungen und Optik** — nicht Modelle, nicht Anwendungen.
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## Sechs Chips, ein Muster: alle bauen ihr eigenes Silizium
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Das im Video genannte Leitmotiv („everyone building their own silicon") beschreibt einen Zustand, in dem die großen Käufer von Beschleuniger-Hardware nicht mehr nur einkaufen, sondern spezifizieren:
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- **Custom Silicon als Produktkategorie:** Qualcomms AlphaWave steht für den Einstieg eines Mobilfunk-Chipherstellers in kundenspezifische Beschleuniger — dieselbe Bewegung, die im Wiki bei [Alibaba](../../../wiki/concepts/hardware/china-local-ai-box.md) (XuanTie C950) und bei den Hyperscalern dokumentiert ist.
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- **Switching als Engpass:** 17.000 Pins an einem Tomahawk-6-Package sind kein Rekord um des Rekords willen — die Pin-Zahl ist die physische Grenze der Bandbreite, die ein Switch-Chip auf die Leiterplatte bringt. Wer Racks mit zehntausenden Beschleunigern baut, hängt an dieser Zahl.
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- **Interconnect wird zur Vertragsbezeichnung:** Wenn ein Spezialchip-Anbieter eine NVLink-Vereinbarung nennt (d-Matrix im Kapitel „NVLink partnership"), wandert NVIDIAs proprietäre Verbindung von der GPU zur Infrastruktur-Ebene. Siehe [[nvidia-dgx-station-748gb.md]] für die Consumer-/Prosumer-Seite derselben Technik.
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- **Optik verlässt das Labor:** Co-Packaged Optics (Ayar Labs) bedeutet, dass der elektrische Weg zwischen Chip und Netzwerk endet — die Optik sitzt im Package. Das ist die Voraussetzung für Rack-Verbünde, die über ein einzelnes Kabel-Budget hinausgehen.
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## Das Gedächtnis ist die eigentliche Schlagzeile
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Der Titel des Videos kommt aus dem letzten Drittel: **„Using Your Older DDR4"**. Im Kapitel zu Astera Labs Leo 2 nennt die Beschreibung **DDR4 und DDR5 in einem System auf einer Next-Gen-Intel-CPU** — also die Koexistenz zweier DRAM-Generationen unter einem Speichercontroller.
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Warum das in dieser Akte mehr ist als eine Fußnote:
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1. **Die Speicherpreise sind der Engpass.** Die Seite [[gaming-hardwarekrise-ai-speicher.md]] dokumentiert, wie KI-Nachfrage nach HBM/DRAM die klassische Speicherversorgung verknappt und Preise treibt. Wenn DDR4 weiter nutzbar bleibt, verlängert sich die Lebensdauer vorhandener Module — genau die „Idee", die der Gruppenbeitrag mit dem Zeitsprung auf `t=10m` meint.
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2. **Speicherbandbreite schlägt Rechenleistung.** Diese These trägt im Wiki bereits [[china-local-ai-box.md]] (Memory-Bandbreite statt Petaflops entscheidet, ob eine Box ein Modell fährt) und [[deepseek-v41-flash-lokale-hardware.md]] (Prefill und Bandbreite als zweite Bremse). Ein Controller, der **zwei DRAM-Generationen** bedient, ist die preisgünstige Variante derselben Einsicht: nicht schnellerer Speicher, sondern **mehr nutzbarer Speicher**.
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3. **Rack-Realität statt Benchmark-Realität.** Ein System, das beide Generationen führt, ist ein Migrationsartefakt. Es sagt: Der Übergang DDR4 → DDR5 läuft in echten Rechenzentren nicht als Stichtag, sondern als Koexistenz — dieselbe Logik wie der [CXL](https://en.wikipedia.org/wiki/Compute_Express_Link)-Ansatz, Speicher auszulagern statt ihn zu ersetzen.
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⚠️ **Die technische Übersetzung DDR4+DDR5 → CXL/Memory-Pooling ist Einordnung dieses Wikis, nicht Beschreibung des Videos.** Die Beschreibung nennt nur die Koexistenz im selben System.
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## Portables Rack und „Compute ohne Rechenzentrum"
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Die Kapitel 02:12 und 04:58 hängen zusammen: erst das Objekt (Sechs-Slot-Rack in Flughafen-Kabinengröße), dann die Frage, wer so etwas kauft. Der Kanal beantwortet die Frage nicht in der Beschreibung — aber die Wiki-Lage dazu ist schon da:
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- [[edge-inference-als-cloud-alternative.md]] — Edge-Inferenz als x86-Alternative, Lunchbox-Format
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- [[cloud-exit-and-local-superiority.md]] — Cloud-Exit als Preis- und Souveränitätsbewegung
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- [[mikrotik-crs804-4ddq-400gbe-switch.md]] — Desktop-Klasse mit 400GbE: dieselbe Verlagerung nach unten
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- [[8-dollar-chip-llm-tinyml.md]] — die untere Kante derselben Skala
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Der Unterschied zu diesen Seiten: hier geht es nicht um Einzelpersonen, sondern um **Institutionen**, die Compute an Orte tragen, an denen kein Rechenzentrum steht. „Who buys edge racks" ist damit die institutionelle Fassung von „Local AI".
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## RISC-V: der zweite Weg zum Silizium
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Das SiFive-Kapitel (11:38) setzt RISC-V in dieselbe Reihe wie die Custom-Silicon-Stationen. Für das Wiki ist das der Anschluss an [[china-local-ai-box.md]] (Alibabas XuanTie C950 als RISC-V-CPU in einer KI-Box, laut Folie 27B @ 30 tok/s ohne GPU) und an [[neuromorphic-chips-und-quantencomputer.md]] (Hardware-Frontier jenseits klassischer Chiparchitekturen, [Mainzer](../../people/klaus-mainzer.md)). Der offene Punkt bleibt derselbe: Eine lizenzfreie Instruction Set Architecture ist eine Voraussetzung für Souveränität, kein Beweis für Leistungsfähigkeit.
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## Quellenkritik: wer hier spricht
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Der Kanal gehört **Dr. Ian Cutress**, Analyst bei **[More Than Moore](../../institutions/more-than-moore.md)**. Die Videobeschreibung trägt einen ausdrücklichen Hinweis auf Interessenkonflikte: More Than Moore erbringt bzw. erbrachte **bezahlte Forschung, Analyse, Beratung oder Consulting** für viele der genannten und verwandten Firmen — darunter AMD, Arm, **Ayar Labs**, Broadcom-nahe Firmen, IBM, Intel, MediaTek, NVIDIA, **Qualcomm**, **SiFive**, TSMC, Tenstorrent und weitere.
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Damit gilt für dieses Blatt:
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- Die Stationen sind **Kanal-Auswahl**, keine Rangliste. Wer am Summit auftrat, hat entweder eine Ankündigung oder ein Budget.
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- Es gibt **kein Transkript**; was im Video argumentiert wird, ist nicht überprüft. Alle Angaben sind Kapitelmarken-Titel und Beschreibungstext, also **redaktionelles Framing**.
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- Zahlen (17.000 Pins, 20-Billionen-Parameter-Racks, 52.330 Aufrufe) sind Momentaufnahmen bzw. Kanal-Angaben ohne unabhängigen Beleg.
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- Die **Marktbewegung** (Custom Silicon, Edge-Racks, Speicher-Koexistenz, Co-Packaged Optics) ist unabhängig von diesem Video gut belegt und in den verlinkten Seiten dokumentiert. Das Video ist ein **Verbreitungs- und Bündelungssignal**, kein Primärbeleg.
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## Verbindung zu anderen Wiki-Seiten
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- [[gaming-hardwarekrise-ai-speicher.md]] — warum „älteres DDR4 weiterverwenden" 2026 eine Strategie ist
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- [[china-local-ai-box.md]] — Speicherbandbreite als Maßstab, RISC-V als Souveränitätspfad
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- [[deepseek-v41-flash-lokale-hardware.md]] — Bandbreite/Prefill als praktische Grenze lokaler Inferenz
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- [[edge-inference-als-cloud-alternative.md]], [[cloud-exit-and-local-superiority.md]] — die private Seite von „Compute ohne Rechenzentrum"
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- [[mikrotik-crs804-4ddq-400gbe-switch.md]] — Netzwerk-Ebene in Desktop-Größe
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- [[nvidia-dgx-station-748gb.md]] — Speicher- und Interconnect-Architekturen im Desktop-Format
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- [[../llm/ai-investment-bubble.md]] — Infrastruktur-Ausgaben als Blasenindikator (Silizium-Nachfrageseite)
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- [[../llm/ai-value-migration-orchestration.md]] — Wertverschiebung in die Infrastruktur-Schicht
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- [[../../decisions/ai-governance-chip-export-controls.md]] — Chips als geopolitisches Steuerinstrument
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- [[../../institutions/nvidia.md]] — NVLink, DGX, Physical AI
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## Quellen
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- [TechTechPotato: „Using Your Older DDR4 // The Silicon Notebook E2"](https://www.youtube.com/watch?v=31_eeq3ciRA) — 52.330 Aufrufe beim Abruf am 20.09.2026, **kein Transkript** (keine `captionTracks`)
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- [Rohquelle mit Metadaten, Kapitelmarken und Disclosure](../../../raw/youtube/2026-09-20_techtechpotato-silicon-notebook-e2.md)
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- [More Than Moore](https://more-moore.com) — Analysefirma des Hosts
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- [TechTechPotato auf YouTube](https://www.youtube.com/@TechTechPotato)
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