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AI-Infrastruktur-Silizium — Custom-Chips, Edge-Racks und das Gedächtnis

„Day two of the AI Infrastructure Summit, where the running theme is everyone building their own silicon." — Videobeschreibung, TechTechPotato, 20.09.2026

Quelle: ../../people/ian-cutress.md in „The Silicon Notebook E2" (Video, Rohquelle, Kanal ../../institutions/more-than-moore.md). Kein Transkript — alle Stationen dieses Blatts stammen aus den Kapitelmarken und der Beschreibung, nicht aus dem Gesprochenen.

Was am Summit gezeigt wurde

Zeit Station Was der Kanal nennt
00:00 Qualcomm AlphaWave — Custom Silicon
00:56 Broadcom Tomahawk 6 — Packages mit 17.000 Pins
02:12 Giga.io ein Sechs-Slot-Rack, das durch die Flughafen-Sicherheitskontrolle passt
04:58 (Diskussion) wer Compute kauft, das an kein Rechenzentrum angeschlossen ist
06:21 d-Matrix Corsair und Pavehawk
06:57 d-Matrix NVLink-Vereinbarung
07:38 Lightning gestapelter DRAM („stacked DRAM")
08:25 Mango Boost, Credo Interconnect-/Beschleuniger-Ebene
09:26 Astera Labs Leo 2 — DDR4 und DDR5 im selben System auf einer Next-Gen-Intel-CPU
11:38 SiFive RISC-V
12:01 Ayar Labs Co-Packaged Optics
13:20 — Wrap und Ausblick auf den nächsten Tag

Das ist die Themenliste eines Fach-Events: Silizium, Speicher, Verbindungen und Optik — nicht Modelle, nicht Anwendungen.

Sechs Chips, ein Muster: alle bauen ihr eigenes Silizium

Das im Video genannte Leitmotiv („everyone building their own silicon") beschreibt einen Zustand, in dem die großen Käufer von Beschleuniger-Hardware nicht mehr nur einkaufen, sondern spezifizieren:

  • Custom Silicon als Produktkategorie: Qualcomms AlphaWave steht für den Einstieg eines Mobilfunk-Chipherstellers in kundenspezifische Beschleuniger — dieselbe Bewegung, die im Wiki bei Alibaba (XuanTie C950) und bei den Hyperscalern dokumentiert ist.
  • Switching als Engpass: 17.000 Pins an einem Tomahawk-6-Package sind kein Rekord um des Rekords willen — die Pin-Zahl ist die physische Grenze der Bandbreite, die ein Switch-Chip auf die Leiterplatte bringt. Wer Racks mit zehntausenden Beschleunigern baut, hängt an dieser Zahl.
  • Interconnect wird zur Vertragsbezeichnung: Wenn ein Spezialchip-Anbieter eine NVLink-Vereinbarung nennt (d-Matrix im Kapitel „NVLink partnership"), wandert NVIDIAs proprietäre Verbindung von der GPU zur Infrastruktur-Ebene. Siehe nvidia-dgx-station-748gb.md für die Consumer-/Prosumer-Seite derselben Technik.
  • Optik verlässt das Labor: Co-Packaged Optics (Ayar Labs) bedeutet, dass der elektrische Weg zwischen Chip und Netzwerk endet — die Optik sitzt im Package. Das ist die Voraussetzung für Rack-Verbünde, die über ein einzelnes Kabel-Budget hinausgehen.

Das Gedächtnis ist die eigentliche Schlagzeile

Der Titel des Videos kommt aus dem letzten Drittel: „Using Your Older DDR4". Im Kapitel zu Astera Labs Leo 2 nennt die Beschreibung DDR4 und DDR5 in einem System auf einer Next-Gen-Intel-CPU — also die Koexistenz zweier DRAM-Generationen unter einem Speichercontroller.

Warum das in dieser Akte mehr ist als eine Fußnote:

  1. Die Speicherpreise sind der Engpass. Die Seite gaming-hardwarekrise-ai-speicher.md dokumentiert, wie KI-Nachfrage nach HBM/DRAM die klassische Speicherversorgung verknappt und Preise treibt. Wenn DDR4 weiter nutzbar bleibt, verlängert sich die Lebensdauer vorhandener Module — genau die „Idee", die der Gruppenbeitrag mit dem Zeitsprung auf t=10m meint.
  2. Speicherbandbreite schlägt Rechenleistung. Diese These trägt im Wiki bereits china-local-ai-box.md (Memory-Bandbreite statt Petaflops entscheidet, ob eine Box ein Modell fährt) und deepseek-v41-flash-lokale-hardware.md (Prefill und Bandbreite als zweite Bremse). Ein Controller, der zwei DRAM-Generationen bedient, ist die preisgünstige Variante derselben Einsicht: nicht schnellerer Speicher, sondern mehr nutzbarer Speicher.
  3. Rack-Realität statt Benchmark-Realität. Ein System, das beide Generationen führt, ist ein Migrationsartefakt. Es sagt: Der Übergang DDR4 → DDR5 läuft in echten Rechenzentren nicht als Stichtag, sondern als Koexistenz — dieselbe Logik wie der CXL-Ansatz, Speicher auszulagern statt ihn zu ersetzen.

⚠️ Die technische Übersetzung DDR4+DDR5 → CXL/Memory-Pooling ist Einordnung dieses Wikis, nicht Beschreibung des Videos. Die Beschreibung nennt nur die Koexistenz im selben System.

Portables Rack und „Compute ohne Rechenzentrum"

Die Kapitel 02:12 und 04:58 hängen zusammen: erst das Objekt (Sechs-Slot-Rack in Flughafen-Kabinengröße), dann die Frage, wer so etwas kauft. Der Kanal beantwortet die Frage nicht in der Beschreibung — aber die Wiki-Lage dazu ist schon da:

Der Unterschied zu diesen Seiten: hier geht es nicht um Einzelpersonen, sondern um Institutionen, die Compute an Orte tragen, an denen kein Rechenzentrum steht. „Who buys edge racks" ist damit die institutionelle Fassung von „Local AI".

RISC-V: der zweite Weg zum Silizium

Das SiFive-Kapitel (11:38) setzt RISC-V in dieselbe Reihe wie die Custom-Silicon-Stationen. Für das Wiki ist das der Anschluss an china-local-ai-box.md (Alibabas XuanTie C950 als RISC-V-CPU in einer KI-Box, laut Folie 27B @ 30 tok/s ohne GPU) und an neuromorphic-chips-und-quantencomputer.md (Hardware-Frontier jenseits klassischer Chiparchitekturen, Mainzer). Der offene Punkt bleibt derselbe: Eine lizenzfreie Instruction Set Architecture ist eine Voraussetzung für Souveränität, kein Beweis für Leistungsfähigkeit.

Quellenkritik: wer hier spricht

Der Kanal gehört Dr. Ian Cutress, Analyst bei More Than Moore. Die Videobeschreibung trägt einen ausdrücklichen Hinweis auf Interessenkonflikte: More Than Moore erbringt bzw. erbrachte bezahlte Forschung, Analyse, Beratung oder Consulting für viele der genannten und verwandten Firmen — darunter AMD, Arm, Ayar Labs, Broadcom-nahe Firmen, IBM, Intel, MediaTek, NVIDIA, Qualcomm, SiFive, TSMC, Tenstorrent und weitere.

Damit gilt für dieses Blatt:

  • Die Stationen sind Kanal-Auswahl, keine Rangliste. Wer am Summit auftrat, hat entweder eine Ankündigung oder ein Budget.
  • Es gibt kein Transkript; was im Video argumentiert wird, ist nicht überprüft. Alle Angaben sind Kapitelmarken-Titel und Beschreibungstext, also redaktionelles Framing.
  • Zahlen (17.000 Pins, 20-Billionen-Parameter-Racks, 52.330 Aufrufe) sind Momentaufnahmen bzw. Kanal-Angaben ohne unabhängigen Beleg.
  • Die Marktbewegung (Custom Silicon, Edge-Racks, Speicher-Koexistenz, Co-Packaged Optics) ist unabhängig von diesem Video gut belegt und in den verlinkten Seiten dokumentiert. Das Video ist ein Verbreitungs- und Bündelungssignal, kein Primärbeleg.

Verbindung zu anderen Wiki-Seiten

Quellen